亞德諾半導體(ADI)近期日前發表新款高性能時脈抖動衰減器– HMC7044，專為支援JESD204B串列介面標準所設計，適用於連接基地台設計中的高速資料轉換器與現場可編程閘陣列(FPGA)。
JESD204B介面為專門針對高資料速率系統設計需求所開發，而3.2 GHz的新款時脈抖動衰減器內建可支援與加強該介面標準的獨特功能，且提供50 fs的抖動性能，可改善高速資料轉換器的信雜比和動態範圍。該元件也提供了十四組低雜訊且可配置的輸出，與許多不同元件連結時更具彈性，並具備各種時脈管理與分配特點，使得基地台的設計者利用單個元件就能建構完整的時脈設計。
此外，基地台應用中有許多串列JESD204B資料轉換器通道需要將其資料框架與FPGA對齊。而該時脈抖動衰減器可在資料轉換器系統中產生信號源同步且可調的樣本與框架對齊(SYSREF)時脈，使JESD204B系統設計得以簡化。
該元件具有兩組鎖相迴路(PLL)和重疊的內建式壓控振盪器(VCO)。第一組PLL將低雜訊的本地壓控時脈振盪器(VCXO)鎖定至雜訊相對較多的參考器，而第二組PLL則以非常少的額外雜訊將VCXO信號倍頻至VCO頻率。
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