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馬不停蹄 PCI-SIG計畫2021完成PCIe 6.0規範

文‧侯冠州 發布日期:2019/06/20 關鍵字:PCI-SIGPCIe 6.0PCIe 5.0PAM4FEC

PCI-SIG於不久前正式發布PCIe 5.0標準之後,近日又於開發者大會上宣布PCIe 6.0的規劃,指出PCIe 6.0的速率和PCIe 5.0相比將再提升一倍,達到64 GT/s,且仍具向後相容性,提供高效率、高性價比的效能,PCI-SIG預計PCIe 6.0的規範將於2021年完成。

PCI-SIG主席兼總裁Al Yanes表示,該協會正持續滿足現今資料吞吐量需求,而延續PCIe 5.0規範設定趨勢,PCIe 6.0制定的腳步持續加快,致力在一個產業能接受的時間範圍內訂定出傳輸頻寬翻倍的標準。

據悉,PCIe 6.0標準的頻寬最高達256 GB/s(在16通道配置下)、原始傳輸率高達 64GT/s,各項標準均是PCIe 5.0的兩倍;同時,PCIe 6.0兼容以往的PCIe介面,不過,和PCIe 5.0不同的地方在於,PCIe 6.0會採用Pulse-Amplitude Modulation 4(PAM4)的編碼技術,而非PCIe 4.0和PCIe 5.0的Non-Return-to-Zero(NRZ)技術,並且採用前向糾錯(Forward Error Correction, FEC)技術提高傳輸速率。

Principral Technologies分析師Dennis Martin指出,經由20年的頻寬改進,PCI Express技術已經成為一種普及的I/O技術,透過PCIe 6.0,將能滿足目前熱門的人工智慧(AI)、機器學習、高效能運算、網路通訊、儲存等應用需求。

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